論文開題報(bào)告：MELP算法FGPA實(shí)現(xiàn)之三

大學(xué)本科畢業(yè)論文(設(shè)計(jì))開題報(bào)告
學(xué)院：　信息科學(xué)與工程學(xué)院　　　　　　　　　　　專業(yè)班級(jí)：　　　　2009級(jí)集成電路設(shè)計(jì)與系統(tǒng)集成1班

課題名稱 MELP算法FGPA實(shí)現(xiàn)之三

1、 本課題的的研究目的和意義：
掌握MELP算法基本原理，掌握Matlab編程和Verilog編程，熟悉DSP C語(yǔ)言，熟悉定點(diǎn)運(yùn)算的編程技巧。通過(guò)melp算法的語(yǔ)音識(shí)別DSR的研究，提出了基于FPGA平臺(tái)的前端處理系統(tǒng)結(jié)構(gòu)。對(duì)其中兩個(gè)除法器分別采用了LUT查找表和常數(shù)除法器的結(jié)構(gòu)。用VerilogHDL語(yǔ)言進(jìn)行建模仿真，并與Ma
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i*ed E*cited Linear Prediction）聲碼器技術(shù)吸收了混合激勵(lì)和多帶激勵(lì)的思想，仍以傳統(tǒng)的LPC模型為基礎(chǔ)，同時(shí)在基音提取和激勵(lì)信號(hào)的產(chǎn)生等方面采用了一些新的方法以提高語(yǔ)音合成質(zhì)量，這些新方法主要包括多帶混合激勵(lì)、使用非周期脈沖、殘差諧波處理技術(shù)、自適應(yīng)譜增強(qiáng)技術(shù)和脈沖整形濾波。其中，非周期脈沖、多帶混合激勵(lì)、自適應(yīng)譜增強(qiáng)和殘差諧波處理技術(shù)用來(lái)改善合成語(yǔ)音的激勵(lì)信號(hào)。 1、語(yǔ)音預(yù)處理濾波器設(shè)計(jì)、1KHZ低通濾波器、0～500Hz，500Hz～1000Hz,1000～2000Hz,2000Hz～3000Hz，3000～4000Hz帶通濾波器設(shè)計(jì)、整數(shù)基音周期提取的FPGA實(shí)現(xiàn)


4、擬解決的關(guān)鍵問(wèn)題：
1. 了解IIR濾波器基本原理
2. 了解verilog語(yǔ)法
3．了解FPGA設(shè)計(jì)流程
4．掌握數(shù)字集成設(shè)計(jì)的基本知識(shí)

5、研究思路、方法和步驟：
1.查找資料，對(duì)課題進(jìn)行初步的分析，制定初步的可行性方案。
2.構(gòu)建查找期刊和查看相應(yīng)文獻(xiàn)編寫verilog代碼構(gòu)造系統(tǒng)模型。
3.通過(guò)軟件將系統(tǒng)模型設(shè)計(jì)出來(lái)，進(jìn)行仿真。
4.根據(jù)初步的仿真結(jié)果，分析優(yōu)化系統(tǒng)結(jié)構(gòu)。


6、本課題的進(jìn)度安排：
掌握MELP算法基本原理，掌握Matlab編程和Verilog編程，熟悉DSP C語(yǔ)言，熟悉定點(diǎn)運(yùn)算的編程技巧。
2013-3-1---2013-3-31 查閱相關(guān)資料，掌握MELP算法基本原理，熟悉Verilog語(yǔ)法，C語(yǔ)言。
2013-4-1---2013-5-31 編寫Verilog代碼、仿真、驗(yàn)證。
2013-1-1-2013-6-20 整理畢業(yè)論文，準(zhǔn)備答辯。


7、參考文獻(xiàn)：
基于MELP的低速率語(yǔ)音編碼算法研究
南京郵電大學(xué)
姓名：李文化
基于FPGA的低速率語(yǔ)音聲碼器的研究與實(shí)現(xiàn).
西安電子科技大學(xué)
時(shí)永鵬
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